标签：数控直流源 - 电子研发网

数控直流源 24637条

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3GHz射频信号源模块GR6710

产品概要： 3GHz射频信号源模块GR6710是软件程控的虚拟仪器模块，可以通过测控软件产生9kHz到3GHz的射频信号源和AM/FM/CW调制输出，具有CPCI、PXI、SPI、RS232、RS485和自定义IO接口。产品描述： 3GHz射频信号源模块GR6710是软件程控的虚拟仪器模块，可以通过测控软件产生9kHz到3GHz的射频信号源和AM/FM/CW调制输出，还可 ...

/dl/20824.html

标签： 3GHz 6710 GR 射频信号源

上传时间： 2013-11-13

上传用户：s363994250

直流电机驱动电路设计

直流电机驱动电路设计

/dl/20981.html

标签： 直流电机驱动电路设计

上传时间： 2013-11-20

上传用户：ca05991270

带有增益提高技术的高速CMOS运算放大器设计

设计了一种用于高速ADC中的高速高增益的全差分CMOS运算放大器。主运放采用带开关电容共模反馈的折叠式共源共栅结构，利用增益提高和三支路电流基准技术实现一个可用于12~14 bit精度，100 MS/s采样频率的高速流水线（Pipelined）ADC的运放。设计基于SMIC 0.25 μm CMOS工艺，在Cadence环境下对电路进行Spectre仿真。仿真结 ...

/dl/21020.html

标签： CMOS 增益提高运算放大器设计

上传时间： 2014-12-23

上传用户：jiiszha

第10章直流电源

§10.1 直流电源的组成及作用 §10.2 整流电路 §10.3 滤波电路 §10.4 稳压二极管稳压电路 §10.5 串联型稳压电路 §10.6 开关型稳压电路

/dl/21096.html

标签： 直流电源

上传时间： 2013-10-16

上传用户：1234567890qqq

X波段低相噪跳频源的设计

结合直接数字频率合成（DDS）和锁相环（PLL）技术完成了X波段低相噪本振跳频源的设计。文章通过软件仿真重点分析了本振跳频源的低相噪设计方法，同时给出了主要的硬件选择和详细电路设计过程。最后对样机的测试结果表明，本方案具有相位噪声低、频率控制灵活等优点，满足了实际工程应用。 ...

/dl/21162.html

标签： X波段跳频源

上传时间： 2013-11-12

上传用户：jiwy

共源共栅两级运放中两种补偿方法的比较

给出了两种应用于两级CMOS 运算放大器的密勒补偿技术的比较,用共源共栅密勒补偿技术设计出的CMOS 运放与直接密勒补偿相比,具有更大的单位增益带宽、更大的摆率和更小的信号建立时间等优点,还可以在达到相同补偿效果的情况下极大地减小版图尺寸. 通过电路级小信号等效电路的分析和仿真,对两种补偿技术进行比较,结果验证了 ...

/dl/21253.html

标签： 共源共栅运放补偿比较

上传时间： 2013-10-14

上传用户：gengxiaochao

CMOS工艺下高摆幅共源共栅偏置电路

共源共栅级放大器可提供较高的输出阻抗和减少米勒效应，在放大器领域有很多的应用。本文提出一种COMS工艺下简单的高摆幅共源共栅偏置电路，且能应用于任意电流密度。根据饱和电压和共源共栅级电流密度的定义,本文提出器件宽长比与输出电压摆幅的关系,并设计一种高摆幅的共源共栅级偏置电路。 ...

/dl/21259.html

标签： CMOS 工艺共源共栅偏置电路

上传时间： 2013-10-08

上传用户：debuchangshi

高增益K波段MMIC低噪声放大器

  基于0．25gm PHEMT工艺，给出了两个高增益K 波段低噪声放大器．放大器设计中采用了三级级联增加栅宽的电路结构，通过前级源极反馈电感的恰当选取获得较高的增益和较低的噪声；采用直流偏置上加阻容网络，用来消除低频增益和振荡；三级电路通过电阻共用一组正负电源，使用方便，且电路性能较好，输入输出驻波比小 ...

/dl/21276.html

标签： MMIC 增益低噪声放大器波段

上传时间： 2014-12-23

上传用户：masochism

二阶有源低通滤波电路分析

设计一种压控电压源型二阶有源低通滤波电路,并利用Multisim10仿真软件对电路的频率特性、特征参量等进行了仿真分析,仿真结果与理论设计一致,为有源滤波器的电路设计提供了EDA手段和依据。

/dl/21284.html

标签： 二阶有源低通滤波电路分析

上传时间： 2013-11-12

上传用户：名爵少年

使用时钟PLL的源同步系统时序分析

使用时钟PLL的源同步系统时序分析一）回顾源同步时序计算Setup Margin = Min Clock Etch Delay – Max Data Etch Delay – Max Delay Skew – Setup TimeHold Margin = Min Data Etch Delay – Max Clock Etch Delay + Min Delay Skew + Data Rate – Hold Time下面解释以上公式中各参数的意义：Etch Delay：与常说的飞行时 ...

/dl/21401.html

标签： PLL 时钟同步系统时序分析

上传时间： 2013-11-05

上传用户：VRMMO

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