设计了一种用于高速ADC中的高速高增益的全差分CMOS运算放大器。主运放采用带开关电容共模反馈的折叠式共源共栅结构，利用增益提高和三支路电流基准技术实现一个可用于12~14 bit精度，100 MS/s采样频率的高速流水线（Pipelined）ADC的运放。设计基于SMIC 0.25 μm CMOS工艺，在Cadence环境下对电路进行Spectre仿真。仿真结果表明，在2.5 V单电源电压下驱动2 pF负载时，运放的直流增益可达到124 dB，单位增益带宽720 MHz，转换速率高达885 V/μs，达到0.1%的稳定精度的建立时间只需4 ns，共模抑制比153 dB。
资源简介：设计了一种用于高速ADC中的高速高增益的全差分CMOS运算放大器。主运放采用带开关电容共模反馈的折叠式共源共栅结构，利用增益提高和三支路电流基准技术实现一个可用于12~14 bit精度，100 MS/s采样频率的高速流水线（Pipelined）ADC的运放。设计基于SMIC 0.25 ...
上传时间： 2014-12-23
上传用户：jiiszha
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上传时间： 2021-10-27
上传用户：ibeikeleilei
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上传时间： 2015-12-21
上传用户：jeffery
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上传时间： 2016-08-28
上传用户：wsf950131
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上传时间： 2017-01-05
上传用户：498732662
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上传时间： 2013-12-30
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上传时间： 2013-12-22
上传用户：lanwei
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上传时间： 2017-08-30
上传用户：zsjinju
资源简介：现代社会信息量爆炸式增长，由于网络、多媒体等新技术的发展，用户对带宽和速度的需求快速增加。并行传输技术由于时钟抖动和偏移，以及PCB布线的困难，使得传输速率的进一步提升面临设计的极限；而高速串行通信技术凭借其带宽大、抗干扰性强和接口简单等优势...
上传时间： 2013-04-24
上传用户：恋天使569
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上传时间： 2016-06-16
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