verilog代码集锦.rar

源代码在线查看: clk_gen.v

软件大小: 37 K
上传用户: soft0318
关键词: verilog 代码 集锦
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								module clk_gen(clk);				output clk;				reg clk;				`include"common.txt"				initial begin				   while($time				   begin				     clk=initial_clock;				     #(period/2)clk=!initial_clock;				     #(period/2);				   end				   $finish;				end				endmodule																																															

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