使用Verilog编写的同步FIFO,可通过设置程序中的DEPTH设置FIFO的深度,FIFO_WRITE_CLOCK上升沿向FIFO中写入数据, FIFO_READ_CLOCK上升沿读取数据。本程序对FIFO上层操作简单实用。
资源简介:使用Verilog编写的同步FIFO,可通过设置程序中的DEPTH设置FIFO的深度,FIFO_WRITE_CLOCK上升沿向FIFO中写入数据,\r\nFIFO_READ_CLOCK上升沿读取数据。本程序对FIFO上层操作简单实用。
上传时间: 2013-08-12
上传用户:ljt101007
资源简介:使用Verilog编写的同步FIFO,可通过设置程序中的DEPTH设置FIFO的深度,FIFO_WRITE_CLOCK上升沿向FIFO中写入数据, FIFO_READ_CLOCK上升沿读取数据。本程序对FIFO上层操作简单实用。
上传时间: 2017-04-08
上传用户:离殇
资源简介:加法器(使用verilog编写的),虽然简单,但是这也是学习verilog最基础的东西!希望大家一起学习!
上传时间: 2013-12-10
上传用户:410805624
资源简介:一个关于MEMORY设计的原代码,使用VERILOG编写的 希望对大家有些帮助
上传时间: 2013-12-24
上传用户:change0329
资源简介:verilog编写的异步fifo源代码,asyn_fifo.v为顶层,调用其他四个文件
上传时间: 2014-01-11
上传用户:jyycc
资源简介:DSP中巴特沃思滤波器的设计使用Verilog编写.
上传时间: 2015-05-06
上传用户:三人用菜
资源简介:verilog HDL原码 一种简单的同步FIFO原码,可以被综合
上传时间: 2013-12-28
上传用户:qwe1234
资源简介:一个可综合的同步FIFO的verilog源代码
上传时间: 2015-12-13
上传用户:天诚24
资源简介:一个verilog语言描写的同步fifo,包括:Fifo using declared registers for storage和Fifo using (model of) standard memory chip for storage.两种方式,包含testbench
上传时间: 2015-12-15
上传用户:Avoid98
资源简介:一个关于热敏打印机时序的仿真程序,能够应用于大多数的热敏打印机中,实现了打印数据的并转串.使用Verilog编写,在Modsim下编译通过.并有最终的仿真波形.
上传时间: 2013-12-27
上传用户:waitingfy