本文利用Verilog HDL 语言自顶向下的设计方法设计多功能数字钟，突出了其作为硬件描述语言的良好的可读性、可移植性和易理解等优点，并通过Altera QuartusⅡ 4.1 和ModelSim SE 6.0 完成综合、仿真。此程序通过下载到FPGA 芯片后，可应用于实际的数字钟显示中。 关键词：Verilog HDL；硬件描述语言；FPGA Abstract: In this ...
/dl/40390.html
标签： Verilog HDL 多功能 数字
上传时间： 2013-11-10
上传用户：hz07104032
DES 加密算法的VHDL和VERILOG 源程序及其TESTBENCH。
/dl/100535.html
标签： TESTBENCH VERILOG VHDL DES
上传时间： 2015-01-04
上传用户：songyue1991
本文为verilog的源代码
/dl/101951.html
标签： verilog 源代码
上传时间： 2015-01-08
上传用户：ahljj
Verilog编码与综合中的非阻塞性赋值
/dl/102279.html
标签： Verilog 编码 非阻塞性赋值
上传时间： 2013-12-23
上传用户：杜莹12345
8位RISC CPU的VERILOG编程 SOURCECODE
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标签： SOURCECODE VERILOG RISC CPU
上传时间： 2015-01-09
上传用户：Andy123456
Verilog DHL教程
/dl/102364.html
标签： Verilog DHL 教程
上传时间： 2014-01-11
上传用户：784533221
sdram的verilog的源码实现
/dl/102365.html
标签： verilog sdram 源码
上传用户：huangld
PCI接口的Verilog源代码
/dl/103568.html
标签： Verilog PCI 接口 源代码
上传时间： 2013-12-28
上传用户：l254587896
有关VERILOG的比较精辟的介绍，不容错过！
/dl/104667.html
标签： VERILOG 比较
上传时间： 2014-09-02
上传用户：王楚楚
Verilog Coding Style for Efficient Digital Design
/dl/107441.html
标签： Efficient Verilog Digital Coding
上传时间： 2015-01-21
上传用户：PresidentHuang
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