在开发板上实现svga条形信号发生器的源代码，是在quartus II 6.0的开发环境中运行的
/dl/193121.html
标签： svga 开发板 信号发生器 源代码
上传时间： 2013-12-23
上传用户：dave520l
信号采集与频谱分析电路，采用quartus平台
/dl/195919.html
标签： 信号采集 频谱分析 电路
上传时间： 2014-01-22
上传用户：dyctj
3des的VHDL实现，适用于quartus环境
/dl/200423.html
标签： 3des VHDL
上传时间： 2015-09-23
上传用户：小码农lz
频率计源代码，性能很好，verilog写的，顶层原理图，底层语言写的，效果很好，开发环境为quartus
/dl/202736.html
标签： 频率计 源代码
上传时间： 2015-09-28
上传用户：wcl168881111111
硬件编程实现伪随机交织器和随机交织器，应用环境Quartus II5.0
/dl/208768.html
标签： 交织器 硬件 伪随机 编程实现
上传时间： 2014-01-11
上传用户：familiarsmile
8位的加法器设计，分4个工程完成的，用的是Quartus II软件。
/dl/213274.html
标签： 8位 加法器
上传时间： 2014-01-20
上传用户：myworkpost
数字滤波器的硬件实现，里面实例可以直接在quartus中运行
/dl/214206.html
标签： 数字滤波器 硬件实现
上传时间： 2013-12-20
上传用户：asdfasdfd
VHDL实现了IIS接口程序，在Quartus II 6.0上编译通过，在板子上可以读取IIS数据
/dl/221649.html
标签： VHDL IIS 接口程序
上传时间： 2014-06-06
上传用户：1427796291
Circular_Buffer，流水线型多位缓存器，verilog语言描述。通过modelsim 6。0仿真，quartus 综合通过。
/dl/224002.html
标签： Circular_Buffer
上传时间： 2014-01-25
上传用户：cuibaigao
full adder设计代码，verilog 语言描述，通过modelsim 仿真，quartus综合
/dl/224003.html
标签： adder full 代码
上传时间： 2015-11-20
上传用户：标点符号
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