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  • OfficePictureManager增量安装(office图片信息补丁包)

    office picture Manager图片阅读和批量处理工具,非常实用,针对有些简化系统上没有的软件,想用最快最方便的进行处理或批处理图片者,这就是不二之选 office图片信息补丁包

    /dl/37942.html

    标签: OfficePictureManager office 增量 补丁

    上传时间: 2013-10-30

    上传用户:稀世之宝039

  • PCB彩色抄板软件QuickPcb2005免安装版

    重要须知━请认真阅读:本《最终用户许可协议》(以下称《协议》)是您(个人或单一实体)与 BSTBIT.COM 之间有关上述 BSTBIT.COM软件产品的法律协议。本“软件产品”包括计算机软件,并可能包括相关媒体、印刷材料和“联机”或电子文档(“软件产品”)。pcb抄板软件搞定了,进行pcb打样时 ...

    /dl/38073.html

    标签: QuickPcb 2005 PCB 彩色

    上传时间: 2013-11-23

    上传用户:liuqy

  • FoxitReader_5.4.3.0920

    超星阅读器

    /dl/38238.html

    标签: FoxitReader 0920

    上传时间: 2013-11-29

    上传用户:283155731

  • OfficePictureManager增量安装(office图片信息补丁包)

    office picture Manager图片阅读和批量处理工具,非常实用,针对有些简化系统上没有的软件,想用最快最方便的进行处理或批处理图片者,这就是不二之选 office图片信息补丁包

    /dl/38566.html

    标签: OfficePictureManager office 增量 补丁

    上传时间: 2013-10-14

    上传用户:playboys0

  • MC8051+IPcore实验教程及相关源代码

      本教程内容力求以详细的步骤和讲解让读者以最快的方式学会 MC8051 IP core 的应用以及相关设计软件的使用,并激起读者对 SOPC 技术的兴趣。本实验重点讲 8051Core 的应用,并通过一个简单 C51 程序对51Core 进行硬件测试。   本实验教程的内容编排如下:   第 1 章简单的描述了 MC8051 IP core的基本结构及一 ...

    /dl/39264.html

    标签: IPcore 8051 MC 实验教程

    上传时间: 2013-10-26

    上传用户:归海惜雪

  • Writing Efficient Testbenches

    本文讨论了如何设计有效的testbench,适合刚接触testbench不久的用户阅读提高 (xilinx公司编写)

    /dl/40123.html

    标签: Testbenches Efficient Writing

    上传时间: 2013-10-11

    上传用户:123454

  • 大规模FPGA设计中的多点综合技术

      本文介绍了在大规模FPGA设计中可以提高综合效率和效果的多点综合技术,本文适合大规模FPGA的设计者和Synplify pro的用户阅读。  

    /dl/40124.html

    标签: FPGA 大规模 多点

    上传时间: 2013-11-04

    上传用户:变形金刚

  • PLD、FPGA优秀设计的十条戒律

    PLD、FPGA优秀设计的十条戒律, 该文浅显易懂的介绍了一个优秀设计必须考虑的问题,给出了设计方法和建议。仔细阅读和消化本文,对提高PLD/FPGA设计水平大有裨益

    /dl/40130.html

    标签: FPGA PLD

    上传时间: 2013-11-07

    上传用户:浅言微笑

  • PLD Programming Using VHDL

    本文详细讨论了VHDL语句对PLD设计的影响和设计经验,经典文章,值得仔细阅读消化。,PLD Programming Using VHDL

    /dl/40137.html

    标签: Programming Using VHDL PLD

    上传时间: 2013-10-14

    上传用户:www240697738

  • HDL的可综合设计简介

    本文简单探讨了verilog HDL设计中的可综合性问题,适合HDL初学者阅读     用组合逻辑实现的电路和用时序逻辑实现的   电路要分配到不同的进程中。   不要使用枚举类型的属性。   Integer应加范围限制。    通常的可综合代码应该是同步设计。   避免门级描述,除非在关键路径中。 ...

    /dl/40140.html

    标签: HDL 综合设计

    上传时间: 2013-11-18

    上传用户:swaylong