叙述了锁相环的应用及其结构特点, 较详细地介绍了锁相集成电路CD4046的结构特点和应用。
/dl/21094.html
标签： 4046 CD 锁相环技术
上传时间： 2013-10-27
上传用户：gxm2052
研究了一种利用corid 算法的矢量及旋转模式对载波同步中相位偏移进行估计并校正的方法.设计并实现了基于corid 算法的数字锁相环.通过仿真验证了设计的有效性和高效性.
/dl/21281.html
标签： 载波同步 设计方案 锁相环
上传时间： 2013-11-21
上传用户：吾学吾舞
锁相环寄存器
/dl/28427.html
标签： 锁相环 寄存器
上传用户：小码农lz
PIC16C54C为8位单片机，指令字长12位，全部指令都是单字节指令，系统为哈佛结构，数据总线和程序总线各自独立分开，数据总线宽度为8位，程序总线宽度为12位，内部程序存储器为512×12位，内部数据寄存器为32×8位。 PIC16C54C有12根双向可独立编程I/O引脚，分为PortA和PortB两个端口，其中PortA为RA0 ...
/dl/29041.html
标签： PIC 16C C54 54C
上传时间： 2013-12-23
上传用户：dianxin61
数字三相锁相环中含有大量乘法运算和三角函数运算，占用大量的硬件逻辑资源。为此，提出一种数字三相锁相环的优化实现方案，利用乘法模块复用和CORDIC算法实现三角函数运算，并用Verilog HDL硬件描述语言对优化前后的算法进行了编码实现。仿真和实验结果表明，优化后的数字三相锁相环大大节省了FPGA的资源，并能快速、准确 ...
/dl/32702.html
标签： FPGA 数字 三相 优化设计
上传时间： 2013-11-15
上传用户：yjj631
ADI锁相环
/dl/32841.html
标签： 4159 ADF ADI 锁相环
上传用户：zaizaibang
/dl/40355.html
上传时间： 2013-10-22
上传用户：emhx1990
PLL是数字锁相环设计源程序, 其中, Fi是输入频率(接收数据), Fo(Q5)是本地输出频率. 目的是从输入数据中提取时钟信号(Q5), 其频率与数据速率一致, 时钟上升沿锁定在数据的上升和下降沿上；顶层文件是PLL.GDF
/dl/131276.html
标签： 数据 Q5 PLL 输入
上传时间： 2014-06-09
上传用户：daguda
用VHDL写的数字锁相环程序 pll.vhd为源文件 pllTB.vhd为testbench
/dl/132718.html
标签： vhd testbench pllTB VHDL
上传时间： 2014-01-20
上传用户：zwei41
锁相环程序，用MATLAB 编写，用来防真琐相环的工作过程。有学习价值
/dl/135524.html
标签： 锁相环 程序
上传时间： 2015-03-31
上传用户：zhangzhenyu
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