用一片CPLD实现数字锁相环,用VHDL或V语言
/dl/8651.html
标签： CPLD VHDL 数字锁相环
上传时间： 2013-05-27
上传用户：hewenzhi
现场可编程门阵列(FPGA)的发展已经有二十多年，从最初的1200门发展到了目前数百万门至上千万门的单片FPGA芯片。现在，FPGA已广泛地应用于通信、消费类电子和车用电子类等领域，但国内市场基本上是国外品牌的天下。 在高密度FPGA中，芯片上时钟分布质量变的越来越重要，时钟延迟和时钟偏差已成为影响系统性能的重要因素。目 ...
/dl/9146.html
标签： FPGA 全数字 延时
上传时间： 2013-06-10
上传用户：yd19890720
FPGA器件在通信、消费类电子等领域应用越来越广泛，随着FPGA规模的增大、功能的加强对时钟的要求也越来越高。在FPGA中嵌入时钟发生器对解决该问题是一个不错的选择。本论文首先，描述并分析了电荷泵锁相环时钟发生器的体系结构、组成单元及各单元的非理想特性；然后讨论并分析了电荷泵锁相环的小信号特性和瞬态特性；并给出 ...
/dl/11850.html
标签： FPGA 200 MHz 内嵌
上传时间： 2013-04-24
上传用户：变形金刚
在过去的十几年间，FPGA取得了惊人的发展：集成度已达到1000万等效门、速度可达到400～500MHz。随着FPGA的集成度不断增大，在高密度FPGA中，芯片上时钟的分布质量就变得越来越重要。时钟延时和时钟相位偏移已成为影响系统性能的重要因素。现在，解决时钟延时问题主要使用时钟延时补偿电路。 为了消除FPGA芯片内的时钟延时， ...
/dl/13062.html
标签： FPGA 应用于 全数字 锁相环
上传时间： 2013-07-06
上传用户：LouieWu
随着现代集成电路技术的发展，锁相环已经成为集成电路设计中非常重要的一个部分，所以对锁相环的研究具有积极的现实意义。然而传统的锁相环大多是数模混合电路，在工艺上与系统芯片中的数字电路存在兼容问题。因此设计一... ...
/dl/13358.html
标签： FPGA 全数字 锁相环
上传时间： 2013-06-09
上传用户：mosliu
·锁相环频率合成器(Motorola 集成电路应用技术丛书)
/dl/14424.html
标签： Motorola nbsp 锁相环 应用技术
上传用户：gxohao
/dl/14604.html
上传时间： 2013-05-28
上传用户：yph853211
基于FPGA实现的一种新型数字锁相环
/dl/17581.html
标签： FPGA 新型数字 锁相环
上传时间： 2013-08-07
上传用户：2467478207
介绍了应用VHDL技术设计嵌入式全数字锁相环路的方法，详细叙述了其工作原理和设计思想，并用可编程逻辑器件FPGA实现。
/dl/17765.html
标签： VHDL 嵌入式 全数字 锁相环路
上传时间： 2013-08-11
上传用户：yare
基于FPGA的全数字锁相环设计,内有设计过程和设计思想
/dl/17864.html
上传时间： 2013-08-13
上传用户：fqscfqj
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