基于FPGA数字频率计的实现，文中有所有的源代码，仅供参考。
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标签： FPGA 数字频率计
上传时间： 2013-08-05
上传用户：13736136189
FIR数字滤波器设计FPGA实现的研究。流水线技术在文中得到了应用，提高了数据处理的速度
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标签： FPGA FIR 数字 滤波器设计
上传时间： 2013-08-06
上传用户：wangyi39
基于FPGA的数字频率计的设计11利用VHDL 硬件描述语言设计,并在EDA(电子设计自动化) 工具的帮助下,用大规模可编程逻辑器件(FPGA/ CPLD) 实现数字频率计的设计原理及相关程序
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标签： FPGA VHDL 数字频率计 硬件描述语言
上传用户：taozhihua1314
FPGA实现的直接数字频率合成器，本文基于DDS的基本原理,利用Altera公司的FPGA芯片FLEX10系列器件完成了一个DDS系统的设计。
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标签： FPGA 数字频率合成器
上传用户：wangzhen1990
实现LCD1602的字符数字字母等显示功能，结合VHDL语言在Q2下实现
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标签： 1602 LCD 字符 字母
上传用户：1234xhb
基于FPGA实现的一种新型数字锁相环
/dl/17581.html
标签： FPGA 新型数字 锁相环
上传时间： 2013-08-07
上传用户：2467478207
异步FIFO是用来适配不同时钟域之间的相位差和频率飘移的重要模块。本文设计的异步FIFO采用了格雷（GRAY）变换技术和双端口RAM实现了不同时钟域之间的数据无损传输。该结构利用了GRAY变换的特点，使得整个系统可靠性高和抗干扰能力强，系统可以工作在读写时钟频率漂移达到正负300PPM的恶劣环境。并且由于采用了模块化结构， ...
/dl/17596.html
标签： FIFO GRAY RAM 适配
上传时间： 2013-08-08
上传用户：13817753084
基于高速数字信号处理器(DSP) 和大规模现场可编程门阵列( FPGA) ,成功地研制了小型\\r\\n化、低功耗的实时视频采集、处理和显示平台. 其中的DSP 负责图像处理,其外围的全部数字逻辑功能都集成在一片FPGA 内,包括高速视频流FIFO、同步时序产生与控制、接口逻辑转换和对视频编/ 解码器进行设置的I2 C 控制核等. 通过增大FIFO ...
/dl/17598.html
标签： FPGA DSP 实时视频 采集
上传用户：PresidentHuang
《数字信号处理的FPGA实现》代码，数字信号处理一些算法的FPGA代码，比较全
/dl/17607.html
标签： FPGA 数字信号处理 代码
上传用户：sssl
基于VHDL语言的一个新型串行数字通信模块。
/dl/17648.html
标签： VHDL 串行 数字通信 模块
上传时间： 2013-08-09
上传用户：bvdragon
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