VHDL语言的高频时钟分频模块。一种新的分频器实现方法。
/dl/17703.html
标签： VHDL 语言 分频 模块
上传时间： 2013-08-10
上传用户：zxh122
采用Altera公司的FPGA芯片，在MAX+plus II软件平台上实现多路HDLC电路
/dl/17965.html
标签： Altera FPGA HDLC plus
上传时间： 2013-08-16
上传用户：ommshaggar
多款FPGA CPLD开发板的原理图，很好的线路设计参考
/dl/18051.html
标签： FPGA CPLD 开发板 原理图
上传时间： 2013-08-18
上传用户：shanml
基于FPGA的多功能数字钟的设计与实现 内附有详尽的Verilog HDL源码，其功能主要有：时间设置，时间显示，跑表，分频，日期设置，日期显示等
/dl/18055.html
标签： Verilog FPGA HDL 多功能
上传用户：问题问题
VHDL语言编写的时钟显示代码，简短而又易懂，个人觉得很不错
/dl/18083.html
标签： VHDL 语言 编写 时钟显示
上传时间： 2013-08-19
上传用户：bpgfl
PROTUES中简单图片显示,请多提意见.谢谢!
/dl/18137.html
标签： PROTUES
上传时间： 2013-08-20
上传用户：wawjj
多路18b20测温显示系统,可同时测量n个第三18b20
/dl/18165.html
标签： 18b20 多路 测温 显示系统
上传时间： 2013-08-21
上传用户：zhangchu0807
关于FPGA的设计方面的诸多经验总结，讨论了设计方面应该注意的问题。
/dl/18197.html
标签： FPGA 方面 经验
上传用户：onewq
FPGA异步时钟设计中的同步策略，需要
/dl/18258.html
标签： FPGA 异步时钟 策略
上传时间： 2013-08-23
上传用户：540750247
通过fpga产生时钟的VHDL源码，QII7.1下调试通过
/dl/18295.html
标签： fpga VHDL 时钟 源码
上传时间： 2013-08-24
上传用户：wtrl
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