基于fpga和sopc的用VHDL语言编写的EDA含异步清0和同步时钟使能的加法计数器

源代码在线查看: cnt10.done

软件大小: 35 K
上传用户: wjm197811
关键词: fpga VHDL sopc EDA
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				Mon Aug 29 13:12:38 2005
							

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