Verilog HDL 编写的CY7C68013 SLAVE FIFO接口程序,实际测试可用。可以直接跟上位机连接,传输数据。
资源简介:Verilog HDL 编写的CY7C68013 SLAVE FIFO接口程序,实际测试可用。可以直接跟上位机连接,传输数据。
上传时间: 2016-10-13
上传用户:ljmwh2000
资源简介:verilog HDL 编写的PWM,是初学CPLD者入门Z资源,epm7128stc100-10
上传时间: 2013-08-30
上传用户:aa54
资源简介:这是一个Verilog HDL编写的RISC cpu的程序,该程序共10个子程序,实现了简单的RISC cpu,可供初学者参考,学习硬件描述语言,及设计方法。该程序通过了modelsim仿真验证。
上传时间: 2015-03-26
上传用户:qiao8960
资源简介:Verilog HDL编写的CPU模型,很经典,比较通用
上传时间: 2013-12-24
上传用户:龙飞艇
资源简介:Verilog HDL编写的总线功能模型,十分有用,需要的下载
上传时间: 2013-12-20
上传用户:ls530720646
资源简介:Verilog HDL实现的I2C Slave模拟
上传时间: 2014-11-17
上传用户:ztj182002
资源简介:Verilog HDL编写的串并转换。采用iout类型口。包含源文件和测试文件。用Modsim编译。
上传时间: 2014-01-15
上传用户:lanwei
资源简介:verilog HDL 编写的PWM,是初学CPLD者入门Z资源,epm7128stc100-10
上传时间: 2015-09-05
上传用户:gdgzhym
资源简介:verilog HDL编写的出租车计费系统
上传时间: 2015-11-20
上传用户:nanshan
资源简介:用verilog hdl编写的一些例程,包括加法器/减法器等等,例子较多就不一一列举了
上传时间: 2013-12-20
上传用户:fhzm5658