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Verilog HDL编写的串并转换。采用iout类型口。包含源文件和测试文件。用Modsim编译。

  • 上传时间: 2014-01-15
  • 上传用户:stzwsy
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  • 标      签: Verilog Modsim iout HDL

资 源 简 介

Verilog HDL编写的串并转换。采用iout类型口。包含源文件和测试文件。用Modsim编译。

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