Verilog HDL编写的串并转换。采用iout类型口。包含源文件和测试文件。用Modsim编译。
资源简介:Verilog HDL编写的串并转换。采用iout类型口。包含源文件和测试文件。用Modsim编译。
上传时间: 2014-01-15
上传用户:lanwei
资源简介:用汇编写的串并转换程序,在masm 下调试
上传时间: 2015-05-01
上传用户:klin3139
资源简介:用verilog HDL编写的并串转换模块,在ISE软件仿真过,也可综合
上传时间: 2014-10-10
上传用户:han_zh
资源简介:一个可综合的串并转换接口verilog源代码
上传时间: 2014-01-07
上传用户:txfyddz
资源简介:用Verilog HDL编写的0832源程序,实现对0832实现D/A转换。也可方便地转换为vhdl源程序。
上传时间: 2013-11-25
上传用户:qiao8960
资源简介:用verilog HDL编写的基于fpga的动态数码管显示程序。
上传时间: 2017-07-09
上传用户:13681659100
资源简介::CPLD 可编程技术具有功能集成度高、设计灵活、开发周期短、成本低等特 点。介绍基于ATMEL 公司的CPLD 芯片ATF1508AS 设计的串并转换和高速 USB 及其在高速高精度数据采集系统中的应用
上传时间: 2017-09-18
上传用户:SimonQQ
资源简介:这是一个Verilog HDL编写的RISC cpu的程序,该程序共10个子程序,实现了简单的RISC cpu,可供初学者参考,学习硬件描述语言,及设计方法。该程序通过了modelsim仿真验证。
上传时间: 2015-03-26
上传用户:qiao8960
资源简介:Verilog HDL 编写的CY7C68013 SLAVE FIFO接口程序,实际测试可用。可以直接跟上位机连接,传输数据。
上传时间: 2016-10-13
上传用户:ljmwh2000
资源简介:自己编写的串并变换的fpga程序,使用verilog语言
上传时间: 2017-02-25
上传用户:zhangliming420