这是一个利用MAX PULL 制作的VHDL的四位全加器的程序 如果有需要仿真图的 请叫站长联系我

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  上传时间： 2016-07-30

  上传用户：asdkin

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  上传时间： 2016-07-30

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  上传时间： 2014-05-31

  上传用户：lht618

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  上传时间： 2014-01-10

  上传用户：baitouyu

• 这是我在ISP编程实验中独立编写的采用结构化描述的四位全加器免费下载

  资源简介：这是我在ISP编程实验中独立编写的采用结构化描述的四位全加器，通过四次映射一位全加器的方式实现了四位全加器的功能，并附有数码显示模块，将全加器的运算结果输出到数码管显示。

  标签： ISP 编程实验 独立 全加器

  上传时间： 2017-01-19

  上传用户：1583060504

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  资源简介：用一位全加器组成四位全加器. 所用语言是Verilog HDL. 主要用在加法器的设计中。

  标签： Verilog HDL 全加器 语言

  上传时间： 2015-05-02

  上传用户：zukfu

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  标签： 全加器 语言 方式

  上传时间： 2014-01-26

  上传用户：siguazgb

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  资源简介：此程序是用VHDL硬件描述语言编写的,实现四位全加器的功能

  标签： VHDL 程序 硬件描述语言 全加器

  上传时间： 2017-01-07

  上传用户：天诚24

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  上传时间： 2016-01-27

  上传用户：yzy6007

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  标签： CPLD MAX 245 USB

  上传时间： 2014-01-01

  上传用户：lingzhichao