一个时钟分频模块,in verilog hdl
/dl/488836.html
标签： verilog hdl in 时钟分频
上传时间： 2013-12-19
上传用户：笨小孩
经典的verilog hdl的48个案例，希望大家喜欢！
/dl/489686.html
标签： verilog hdl 案例
上传时间： 2013-12-22
上传用户：familiarsmile
串口8位数据 verilog hdl提取
/dl/490589.html
标签： verilog hdl 串口 8位
上传时间： 2014-01-01
上传用户：hasan2015
基于verilog hdl的UART串口接收子程序。
/dl/492760.html
标签： verilog UART hdl 串口接收
上传时间： 2017-09-24
上传用户：561596
基于verilog hdl的UART串口发送子程序。
/dl/492763.html
标签： verilog UART hdl 串口发送
上传用户：aysyzxzm
介绍Verilog HDL, 内容包括： – Verilog应用 – Verilog语言的构成元素 – 结构级描述及仿真 – 行为级描述及仿真 – 延时的特点及说明 – 介绍Verilog testbench • 激励和控制和描述 • 结果的产生及验证 – 任务task及函数function – 用户定义的基本单元(primitive) – 可综合的Verilog描述风格 ...
/dl/492784.html
标签： Verilog HDL 仿真 语言
上传用户：shanml
可编程逻辑器件相关专辑 96册 1.77GVerilog-HDL实践与应用系统设计 210页 18.0M.pdf
/dl/503344.html
标签：
上传时间： 2014-05-05
上传用户：时代将军
可编程逻辑器件相关专辑 96册 1.77G精通Verilog HDL：IC设计核心技术实例详解 377页 56.9M.pdf
/dl/503356.html
学习Verilog HDL 和FPGA 之间，始终会出现一组群体，他们都是徘徊在学习的边缘。 在他们的心中一直回响着这样的一个问题：“我在学什么，为什么不管我怎么学，我都 没有实感... ” 没错这就是初学Verilog HDL + FPGA 的心声。
/dl/510326.html
标签： FPGA Verilog 建模
上传时间： 2016-04-08
上传用户：ly200524
从PCB Design Studio起步（HDL概念描述〕haoshu!
/dl/510492.html
标签： Design Studio PCB HDL
上传时间： 2016-04-21
上传用户：marktian2010
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