这是一个量化编码当中关于A律和u律压缩和扩展的源程序，程序由VerilogHDL语言编写，算法在Modelsim上进行仿真过
/dl/267768.html
标签： 量化 编码 扩展 源程序
上传时间： 2016-03-06
上传用户：klin3139
从算法设计到硬线逻辑的实现——实验练习与Verilog语法手册，与先前传的《VerilogHDL教程》配合使用，Pdg格式，请用超星阅览器打开。
/dl/276438.html
标签： Verilog 算法设计 实验
上传时间： 2014-10-28
上传用户：zycidjl
在信息信号处理过程中，如对信号的过滤、检测、预测等，都要使用滤波器，数字滤波器是数字信号处理（DSP，DigitalSignalProcessing）中使用最广泛的一种器件。常用的滤波器有无限长单位脉冲响应（ⅡR）滤波器和有限长单位脉冲响应（FIR）滤波器两种[1]，其中，FIR滤波器能提供理想的线性相位响应，在整个频带上获得常数群时 ...
/dl/284213.html
标签： 信号处理 过程
上传时间： 2016-04-15
上传用户：gut1234567
单级CIC2倍内插滤波器，用verilogHDL实现
/dl/303148.html
标签： CIC2 内插 滤波器
上传时间： 2014-01-08
上传用户：sunjet
改进的DCT算法设计，veriloghdl实现
/dl/345326.html
标签： DCT 算法设计
上传时间： 2016-09-22
上传用户：tianyi223
设计一个简单的8比特ALU和一个简单的存储器，是用VerilogHDL实现的，这是个题目及其解析
/dl/366285.html
标签： ALU 比特 存储器
上传时间： 2013-12-19
上传用户：lht618
设计一个简单的8比特ALU的源代码，是用VerilogHDL实现的
/dl/366287.html
标签： ALU 比特 源代码
上传时间： 2014-01-01
上传用户：牛布牛
设计一个简单存储器的源代码，是用VerilogHDL实现的
/dl/366288.html
标签： 存储器 源代码
上传时间： 2016-11-14
上传用户：xieguodong1234
数字电路设计教程，veriloghdl设计
/dl/374228.html
标签： 数字电路 设计教程
上传时间： 2016-12-03
ISCAS的benchmark 含有原理图，VHDL、VerilogHDL网表，测试数据等。 27-channel interrupt controller
/dl/375848.html
标签： benchmark ISCAS 原理图
上传时间： 2016-12-07
上传用户：h886166
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