全加器的VHDL_CODE和TEST_BENCH 無須解壓縮密碼
/dl/155253.html
标签： TEST_BENCH VHDL_CODE 全加器
上传时间： 2013-12-22
上传用户：hongmo
8篇测试向量(Test_Bench)和波形产生的例子(VHDL语言，开发环境：FPGA)
/dl/277077.html
标签： Test_Bench VHDL 测试 向量
上传时间： 2013-12-10
上传用户：qiao8960
软件开发环境：ISE 7.1i 硬件开发环境：红色飓风II代－Xilinx版 1. 本实例用于控制开发板上面的SDRAM完成读写功能； 先向SDRAM里面写数据，然后再将数据读出来做比较，如果不匹配就通过LED变亮显示出来，如果一致，LED就不亮。 2. part1目录是使用Modelsim仿真的工程； 3. part2目录是在开发版上面验证的工程； 2.1. ...
/dl/12618.html
标签： Modelsim SDRAM 读写 控制
上传时间： 2013-04-24
上传用户：ZJX5201314
<Floating Point Unit Core> fpupack.vhd pre_norm_addsub.vhd addsub_28.vhd post_norm_addsub.vhd pre_norm_mul.vhd mul_24.vhd vcom serial_mul.vhd post_norm_mul.vhd pre_norm_div.vhd serial_div.vhd post_norm_div.vhd pre_norm_sqrt.vhd sqrt.vhd post_norm_sqrt.vhd comppack.vhd fpu.vhd ***For simulation **** ...
/dl/172732.html
标签： vhd post_norm_addsub pre_norm_addsub Floating
上传时间： 2014-01-18
上传用户：czl10052678
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