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Stratix 59条

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Stratix V FPGA 28 nm创新技术超越摩尔定律

　　本白皮书介绍 Stratix V FPGA 是怎样帮助用户提高带宽同时保持其成本和功耗预算不变。在工艺方法基础上，Altera 利用 FPGA 创新技术超越了摩尔定律，满足更大的带宽要求，以及成本和功耗预算。Altera Stratix ® V FPGA 通过 28-Gbps 高功效收发器突破了带宽限制，支持用户使用嵌入式 HardCopy ®模块将更多的 ...

/dl/32417.html

标签： Stratix FPGA 28 创新技术

上传时间： 2013-10-30

上传用户：luke5347

Altera公司 Stratix V GX FPGA开发板电路图

本资料是关于Altera公司 Stratix V GX FPGA开发板电路图的资料。资料包括开发板原理图、PCB图。

/dl/32421.html

标签： Stratix Altera FPGA GX

上传时间： 2014-01-22

上传用户：18707733937

Stratix V FPGA 28 nm创新技术超越摩尔定律

　　本白皮书介绍 Stratix V FPGA 是怎样帮助用户提高带宽同时保持其成本和功耗预算不变。在工艺方法基础上，Altera 利用 FPGA 创新技术超越了摩尔定律，满足更大的带宽要求，以及成本和功耗预算。Altera Stratix ® V FPGA 通过 28-Gbps 高功效收发器突破了带宽限制，支持用户使用嵌入式 HardCopy ®模块将更多的 ...

/dl/39645.html

标签： Stratix FPGA 28 创新技术

上传时间： 2013-10-08

上传用户：坏天使kk

Altera公司 Stratix V GX FPGA开发板电路图

本资料是关于Altera公司 Stratix V GX FPGA开发板电路图的资料。资料包括开发板原理图、PCB图。

/dl/39649.html

标签： Stratix Altera FPGA GX

上传时间： 2013-10-25

上传用户：风为裳的风

4-7segment led display Verilog code. Implemented at Stratix EP1S25 DSP development board.

4-7segment led display Verilog code. Implemented at Stratix EP1S25 DSP development board.

/dl/195746.html

标签： Implemented development segment display

上传时间： 2014-01-12

上传用户：水中浮云

Interpolation FIR Design Example for Stratix Devices

Interpolation FIR Design Example for Stratix Devices

/dl/207899.html

标签： Interpolation Example Devices Stratix

上传时间： 2014-01-19

上传用户：zhouli

在stratix里实现快速傅立叶变换的具体源码

在stratix里实现快速傅立叶变换的具体源码，以及优化说明

/dl/240548.html

标签： stratix 傅立叶变换源码

上传时间： 2015-12-30

上传用户：LIKE

本文主要分析了FIR数字滤波器的基本结构和硬件构成特点,简要介绍了FIR滤波器实现的方式优缺点结合Altera公司的Stratix系列产品的特点,以一个基于MAC的8阶FIR数字滤波器的设计为例,给

本文主要分析了FIR数字滤波器的基本结构和硬件构成特点,简要介绍了FIR滤波器实现的方式优缺点结合Altera公司的Stratix系列产品的特点,以一个基于MAC的8阶FIR数字滤波器的设计为例,给出了使用Verilog硬件描述语言进行数字逻辑设计的过程和方法,并且在QuartusⅡ的集成开发环境下编写HDL代码,进行综合利用QuartusⅡ内部的仿 ...

/dl/395808.html

标签： FIR Stratix Altera MAC

上传时间： 2017-01-24

上传用户：Miyuki

This document gives the code for programming a CC2500 transceiver using Altera Stratix FPGA. The FPG

This document gives the code for programming a CC2500 transceiver using Altera Stratix FPGA. The FPGA and CC2500 are connected through SPI mode with the FPGA as the master and CC2500 as the slave.

/dl/459496.html

标签： programming transceiver document Stratix

上传时间： 2014-01-15

上传用户：wuyuying

DDR2控制器IP的设计与FPGA实现.rar

DDR2 SDRAM是目前内存市场上的主流内存。除了通用计算机系统外，大量的嵌入式系统也纷纷采用DDR2内存，越来越多的SoC系统芯片中会集成有DDR2接口模块。因此，设计一款匹配DDR2的内存控制器将会具有良好的应用前景。论文在研究了DDR2的JEDEC标准的基础上，设计出DDR2控制器的整体架构，采用自项向下的设计方法和模块化的思 ...

/dl/9188.html

标签： DDR2 FPGA 控制器

上传时间： 2013-06-10

上传用户：ynzfm

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Altera公司 Stratix V GX FPGA开发板电路图

4-7segment led display Verilog code. Implemented at Stratix EP1S25 DSP development board.

Interpolation FIR Design Example for Stratix Devices

在stratix里实现快速傅立叶变换的具体源码

本文主要分析了FIR数字滤波器的基本结构和硬件构成特点,简要介绍了FIR滤波器实现的方式优缺点结合Altera公司的Stratix系列产品的特点,以一个基于MAC的8阶FIR数字滤波器的设计为例,给

This document gives the code for programming a CC2500 transceiver using Altera Stratix FPGA. The FPG

DDR2控制器IP的设计与FPGA实现.rar

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