基于FPGA实现的一种新型数字锁相环
/dl/17581.html
标签： FPGA 新型数字 锁相环
上传时间： 2013-08-07
上传用户：2467478207
相关于fpga的vga显示的控制，包括模块，设计思路，方案等重要代码
/dl/17745.html
标签： fpga vga 控制
上传时间： 2013-08-11
上传用户：青春给了作业95
介绍了应用VHDL技术设计嵌入式全数字锁相环路的方法，详细叙述了其工作原理和设计思想，并用可编程逻辑器件FPGA实现。
/dl/17765.html
标签： VHDL 嵌入式 全数字 锁相环路
上传用户：yare
基于FPGA的全数字锁相环设计,内有设计过程和设计思想
/dl/17864.html
标签： FPGA 全数字 锁相环
上传时间： 2013-08-13
上传用户：fqscfqj
基于FPGA设计数字锁相环，提出了一种由微分超前/滞后型检相器构成数字锁相环的Verilog-HDL建模方案
/dl/18093.html
标签： FPGA 数字锁相环
上传时间： 2013-08-19
上传用户：Huge_Brother
针对高频感应加热电源中用传统的模拟锁相环跟踪频率所存在的问题,提出一种非常适合于高频感应加热的\r\n新型的数字锁相环。使用FPGA 内底层嵌入功能单元中的数字锁相环74HCT297 ,并添加少量的数字电路来实现。最后利\r\n用仿真波形验证该设计的合理性和有效性。整个设计负载范围宽、锁相时间短,现已成功应用于100 kHz/ 30 k ...
/dl/18237.html
标签： 高频感应 加热电源 模拟锁相环 频率
上传时间： 2013-08-22
上传用户：nairui21
关于数字锁相环的一点东西,可以下来看看\r\n
/dl/18354.html
标签： 数字锁相环
上传时间： 2013-08-26
上传用户：7891
Verilog实现的DDS正弦信号发生器和测频测相模块，DDS模块可产生两路频率和相位差均可预置调整的值正弦波，频率范围为20Hz-5MHz，相位范围为0°-359°，测量的数据通过引脚传输给单片机，单片机进行计算和显示。
/dl/18425.html
标签： Verilog DDS 正弦信号发生器 模块
上传时间： 2013-08-28
上传用户：asdfasdfd
意法半导体静电计单相组合解决方案 图 意法半导体静电计单相组合解决方案
/dl/20164.html
标签： 半导体 静电计 单相 组合
上传时间： 2013-10-23
上传用户：Aidane
锁相放大器资料。
/dl/20246.html
标签： 2012 TI 锁相放大器 模块
上传时间： 2013-11-28
上传用户：life840315
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