单片机音乐中音调和节拍的确定方法:调号-音乐上指用以确定乐曲主音高度的符号。很明显一个八度就有12个半音。A、B、C、D、E、F、G。经过声学家的研究，全世界都用这些字母来表示固定的音高。比如，A这个音，标准的音高为每秒钟振动440周。 升C调：1＝#C，也就是降D调：1＝BD；277（频率）升D调：1＝#D，也就是降E调：1＝BE ...
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标签： 单片机 音调
上传时间： 2013-10-20
上传用户：哈哈haha
本文介绍使用AT89C2051 制作的一种发音电路, 各种声音通过编程实现, 灵活方便。原理图如图1 所示。图1 发音电路原理该电路利用方波谐波成份丰富的特点,编程采用计时器延迟法发音, 即每个音的半周期计时中断一次, 而使输出P110 (或其他IöO 口) 反相, 重复执行产生某种频率的信号。例如: 中音DO 的频率为523Hz, 其周期 ...
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标签： 用单片机 发音 电路
上传时间： 2013-10-11
上传用户：Altman
单片机应用技术选编10 目录 第一章 专题论述1.1 嵌入式系统的技术发展和我们的机遇(2)1.2 一种新的电路设计和实现方法——进化硬件(8)1.3 从8/16位机到32位机的系统设计(13)1.4 混合SoC设计(18)1.5 AT24系列存储器数据串并转换接口的IP核设计(23)1.6 低能耗嵌入式系统的设计(28)1.7 嵌入式应用中的零功耗系统设计(31)1.8 数 ...
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标签： 单片机 应用技术
上传时间： 2013-12-04
上传用户：vmznxbc
单片机应用技术选编(9) 目录 第一章 专题论述1.1 集成电路进入片上系统时代(2)1.2 系统集成芯片综述(10)1.3 Java嵌入技术综述(18)1.4 Java的线程机制(23)1.5 嵌入式系统中的JTAG接口编程技术(29)1.6 EPAC器件技术概述及应用(37)1.7 VHDL设计中电路简化问题的探讨(42)1.8 8031芯片主要模块的VHDL描述与仿真(48)1.9 ISP技术在 ...
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上传时间： 2014-04-14
上传用户：gtf1207
一概述影响单片机系统运行稳定性的因素可大体分为外因和内因两部分1. 外因􀁺 射频干扰它是以空间电磁场的形式传递在机器内部的导体引线或零件引脚感生出相应的干扰可通过电磁屏蔽和合理的布线/器件布局衰减该类干扰􀁺 电源线或电源内部产生的干扰它是通过电源线或电源内的部件耦合或直接传导可通过电源滤波 ...
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标签： 单片机复位 电路设计
上传时间： 2014-01-18
上传用户：shanxiliuxu
为了减少电力电子装置对电网引起的谐波污染,在变频器接入电网之前加入PFC电路是一种趋势。讨论了基于TMS320LF2407的全数字控制的单相PFC电路的工作原理,并由此得到了主电路参数的选取原则;建立了单相Boost型数字PFC的小信号动态模型,并分析了基于该模型的数字控制设计方法,给出了设计软件流程;最后搭建了一台样机,在实际 ...
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标签： Boost DSP PFC 单相
上传时间： 2014-12-28
上传用户：zhangyi99104144
针对使用硬件描述语言进行设计存在的问题，提出一种基于FPGA并采用DSP Builder作为设计工具的数字信号处理器设计方法。并按照Matlab/Simulink/DSP Builder/QuartusⅡ设计流程，设计了一个12阶FIR 低通数字滤波器，通过Quartus 时序仿真及嵌入式逻辑分析仪SignalTapⅡ硬件测试对设计进行了验证。结果表明，所设计的FIR 滤波 ...
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标签： Builder FPGA DSP 数字信号处理器
上传时间： 2013-11-17
上传用户：lo25643
在综合分析谐波励磁无刷同步发电机励磁控制系统的基础上,对其励磁控制策略进行了研究,开发了一套基于DSP( TMS320F2812) 控制的新型柴油发电机励磁控制系统,该系统采用参数自适应模糊PID 控制励磁,选用交流采样方式实时检测各信号的瞬时特性,系统仿真结果以及在1 台25 kW 工频柴油发电机上的试验结果证明了该控制器具有较好 ...
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标签： DSP 柴油发电机 励磁控制 系统研究
上传时间： 2013-10-29
上传用户：fxf126@126.com
随着数字音频技术的不断发展，数字化音频设备已广泛应用于广播电视节目领域。鉴于专业数字音频设备越来越多地需求，以及专用接收发送设备的复杂性，本设计采用Philips公司的ARM7控制芯片LPC2138结合音响设备专用芯片，设计一个简单的AES/EBU（AES3）数字音频收发系统，实现了专业AES3数字音频的 ...
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标签： 2138 AES3 LPC 数字音频
上传时间： 2013-11-11
上传用户：ruan2570406
以Altera公司的Quartus Ⅱ 7.2作为开发工具，研究了基于FPGA的DDS IP核设计，并给出基于Signal Tap II嵌入式逻辑分析仪的仿真测试结果。将设计的DDS IP核封装成为SOPC Builder自定义的组件，结合32位嵌入式CPU软核Nios II，构成可编程片上系统（SOPC），利用极少的硬件资源实现了可重构信号源。该系统基本功能都在FPGA芯片 ...
/dl/32544.html
标签： FPGA DDS IP核 设计方案
上传时间： 2013-11-06
上传用户：songkun
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