设计了一种能使FPGA的主状态机直接管理Flash的控制器，该控制器具有自己的指令集和中断管理方式。用户可以根据FPGA的系统时钟对控制器进行操作，无需关心Flash对指令和数据的时序要求。控制器建立了自己的坏块管理机制，合并了一些Flash的常用关联指令，方便了用户对FPGA主状态机的设计。 ...
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标签： Flash FPGA G08 9F
上传时间： 2013-10-08
上传用户：shen007yue
问：MAM 使用注意事项？ 答：当改变 MAM 定时值时，必须先通过向 MAMCR 写入 0 来关闭 MAM，然后将新值写入 MAMTIM。最后，将需要的操作模式的对应值写入 MAMCR，再次打开 MAM。对于低于 20MHz 的系统时钟，MAMTIM 设定为 001。 ...
/dl/35541.html
标签： ARM 基础知识
上传时间： 2013-10-22
上传用户：cx111111
CH451 使用一个系统时钟信号来同步芯片内部的各个功能部件，例如，当系统时钟信号的频率变高时，显示驱动刷新将变快、按键响应时间将变短、上电复位信号的宽度将变窄、看门狗周期也将变短。一般情况下，CH451 的系统时钟信号是由内置的阻容振荡提供的，这样就不再需要任何外围电路，但内置RC 振荡的频率受电源电压的影响较 ...
/dl/37366.html
标签： 451 ch 数码管 实例程序
上传时间： 2013-11-22
上传用户：671145514
Xilinx UltraScale™ 架构针对要求最严苛的应用，提供了前所未有的ASIC级的系统级集成和容量。 UltraScale架构是业界首次在All Programmable架构中应用最先进的ASIC架构优化。该架构能从20nm平面FET结构扩展至16nm鳍式FET晶体管技术甚至更高的技术，同 时还能从单芯片扩展到3D IC。借助Xilinx Vivado® ...
/dl/38739.html
标签： UltraScale Xilinx 架构
上传时间： 2013-12-23
上传用户：小儒尼尼奥
建了一个基于Altera 的EP2S60硬件处理平台,利用Altera提供的FFT IP核,在100 MHz系统时钟下,数据吞吐率可达100 Ms/s。
/dl/40044.html
标签： 线性卷积 实现方案
上传时间： 2015-01-02
上传用户：Zxcvbnm
随着系统设计复杂性和集成度的大规模提高，电子系统设计师们正在从事100MHZ以上的电路设计，总线的工作频率也已经达到或者超过50MHZ，有一大部分甚至超过100MHZ。目前约80% 的设计的时钟频率超过50MHz，将近50% 以上的设计主频超过120MHz，有20%甚至超过500M。当系统工作在50MHz时，将产生传输线效应和信号的完整性问题；而 ...
/dl/40328.html
标签： 高速电路 传输线 效应分析
上传时间： 2013-11-05
上传用户：tzrdcaabb
/dl/40351.html
上传时间： 2013-10-28
上传用户：wangzhen1990
提出了一种基于9/7小波的二维小波变换器的硬件设计方案.通过优化算法以及采用行列变换并行处理的方式,提高了变换器的数据吞吐量.该方案采用了流水线技术,较大地提高了硬件效率.综合结果表明,该方案的系统时钟可达到110 MHz,且具有高速、高吞吐量、片内存储器小等优点. ...
/dl/41955.html
标签： JPEG 2000 VLSI 二维小波变换
上传时间： 2015-01-03
上传用户：yangbo69
SPI（Serial Peripheral Interface，串行外围接口）是Motorola公司提出的外围接口协议，它采用一个串行、同步、全双工的通信方式，解决了微处理器和外设之间的串行通信问题，并且可以和多个外设直接通信，具有配置灵活，结构简单等优点。根据全功能SPI总线的特点，设计的SPI接口可以最大发送和接收16位数据；在主模式和从模 ...
/dl/42297.html
标签： SPI 接口的设计
上传时间： 2013-11-11
上传用户：himbly
文件功能 44binit.s----中断初始化，存储器，堆栈，系统初始化，建立C程序运行环境。 mencfg.s-----定义存储器延时等参数 option.s-----定义系统时钟频率等 main.c-------主函数 44blib.c-----S3C44B0X的一些自己编写的库文件
/dl/140967.html
标签： binit 44 中断 初始化
上传时间： 2015-04-14
上传用户：yuchunhai1990
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