用M16控制,定时器工作于计数方式,计数值同步显示在LCD上
/dl/329580.html
标签： M16 LCD 控制 定时器
上传时间： 2014-10-10
上传用户：shinesyh
低频频率计 实例目的：学习定时器、计数器、中断应用 说明：选用24MHz的晶体，主频可达2MHz。用T1产生100us的时标，T0作信号脉冲计数器。假设晶体频率没有误差，而且稳定不变（实际上可达万分之一）；被测信号是周期性矩形波（正负脉冲宽度都不能小于0.5us），频率小于1MHz，大于1Hz。要求测量时标1S，测量精度为0.1％。 ...
/dl/334766.html
标签： MHz 24 低频 中断应用
上传时间： 2016-08-19
上传用户：wxhwjf
在软件接收机的基础上,利用鉴频器辅助鉴相器的输出,引入一个模糊逻辑控制器,使得环路能够智能跟踪信号的动态变化.实验结果证明所提出的设计方法与传统环路相比可大幅度缩短跟踪时间,减小环路滤波器带宽,并能消除周跳.
/dl/340579.html
标签： 环路 软件接收机 模糊逻辑 控制器
上传时间： 2016-09-01
上传用户：lindor
基于Hart协议智能压力变送器的信息融合技术。
/dl/343322.html
标签： Hart 协议 信息融合 压力变送器
上传时间： 2013-11-26
上传用户：zhouli
80C51单片机中结合555电路实验和单片机定时器频率计实验，里面包含555定时器的datasheet和实验源程序
/dl/348100.html
标签： 80C51 555 单片机 电路实验
上传时间： 2016-09-29
上传用户：cuiyashuo
本文使用实例描述了在 FPGA/CPLD 上使用 VHDL 进行分频器设 计，包括偶数分频、非 50％占空比和 50％占空比的奇数分频、半整数 （N+0.5）分频、小数分频、分数分频以及积分分频。所有实现均可 通过 Synplify Pro 或 FPGA 生产厂商的综合器进行综合，形成可使 用的电路，并在 ModelSim 上进行验证。 ...
/dl/349872.html
标签： FPGA CPLD VHDL 分频器
上传时间： 2013-12-15
上传用户：从此走出阴霾
利用8051的定时器用来计数作为频率计的基础。测频范围是1--10000HZ
/dl/351670.html
标签： 10000 8051 HZ 定时器
上传时间： 2014-10-28
上传用户：tuilp1a
FIQ有FIQ_PWM、FIQ_TMA和FIQ_TMB三个中断源,当定时器A或B计满溢出时产生中断请求信号TA_TIMEOUT_INT或TA_TIMEOUT_INT,CPU响应后进入中断执行相应的子程序控制二极管发光。A口的低四位接LED灯，B口的低四位接LED灯.
/dl/352354.html
标签： TA_TIMEOUT_INT FIQ_PWM FIQ_TMA FIQ_TMB
上传时间： 2013-12-11
上传用户：凤临西北
自己写的一个调试器模型的源码, 有单步功能和反汇编引擎.
/dl/362255.html
标签： 调试器 模型 反汇编 引擎
上传时间： 2016-11-04
上传用户：woshiayin
一个ＤＤＳ前端的串口通讯编程的程序。可以实现分频和指定步进的计数。计到终点值就锁定频率。
/dl/365789.html
标签： 串口通讯 编程 程序 分频
上传时间： 2014-01-18
上传用户：努力努力再努力
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