关键词：FPGA 数字电路 时序 时延路径 建立时间 保持时间
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标签： FPGA 数字电路 保持 时序
上传时间： 2013-08-31
上传用户：梧桐
本设计要实现一个具有预置数的数字钟的设计,具体要求如下:\r\n1. 正确显示年、月、日 \r\n2. 正确显示时、分、秒 \r\n3. 具有校时,整点报时和秒表功能 \r\n4. 进行系统模拟仿真和下载编程实验,验证系统的正确性 \r\n
/dl/18549.html
标签： CPLD 设计实现 数字 预置数
上传时间： 2013-09-01
上传用户：ysjing
数字信号处理在FPGA上实现的经典教材，本书详细介绍了数字信号处理的算法，以及其在FPGA上用硬件描述语言实现
/dl/18560.html
标签： FPGA 数字信号处理 教材
上传用户：frank1234
数字信号处理的FPGA实现(第二版）书的源代码。
/dl/18565.html
标签： FPGA 数字信号处理 源代码
上传用户：wangzhen1990
摘要本文介绍了一种用CPLD设计GPS数字通道相关器中C／A码产生嚣的方法，详细分析了设计原理并给出了相应的仿真结果．这种设计方法已在我们研制的GPS，GLONASS兼容机中得到实际应用。
/dl/18587.html
标签： CPLD GPS 数字
上传用户：wangdean1101
《FPGA数字电子系统设计与开发实例导航》的配套光盘，Verilog编写，USB、I2C、MAC的接口设计
/dl/18590.html
标签： FPGA 数字电子 开发实例 导航
上传用户：410805624
EDA 实验原代码 包括数字脉冲 触发器 和交通灯等
/dl/18591.html
标签： EDA 实验 代码 交通灯
上传用户：wdq1111
基于FPGA的直接数字合成器的设计与分析的代码程序,代码格式为VHDL
/dl/18599.html
标签： FPGA VHDL 代码 直接数字合成器
上传时间： 2013-09-02
上传用户：ifree2016
ＦＰＧＡ数字钟的设计，用VHDL语言编程，max+plus仿真，可在实际电路中验证
/dl/18614.html
标签： 数字
上传用户：packlj
数字设计——CPLD应用与VHDL源文件，很不错的，希望能对大家有用
/dl/18632.html
标签： CPLD VHDL 数字设计
上传时间： 2013-09-03
上传用户：wkchong
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