用verilog写的cpld的各种分频程序，希望大家指正，谢谢！
/dl/167831.html
标签： verilog cpld 分频 程序
上传时间： 2015-06-23
上传用户：nanxia
第7章数字系统设计实例 7.1 半整数分频器的设计 7.2 音乐发生器 7.3 2FSK/2PSK信号产生器 7.4 实用多功能电子表 7.5 交通灯控制器 7.6 数字频率计
/dl/167926.html
标签： 7.1 7.2 7.3 FSK
上传用户：tianyi223
利用VHDL语言编写的一个16分频器，另外可以在程序中修改为任意2N的分频器
/dl/171561.html
标签： VHDL 语言 编写 分频器
上传时间： 2014-01-18
上传用户：erkuizhang
vhdl N-0.5分频方法设计，可以输入任意数值N，即分得到N－0.5的频率。
/dl/171623.html
标签： vhdl 0.5 分频
上传时间： 2014-06-23
上传用户：一诺88
数控分频器设计:对于一个加法计数器，装载不同的计数初始值时，会有不同频率的溢出输出信号。计数器溢出时，输出‘1’电平，同时溢出时的‘1’电平反馈给计数器的输入端作为装载信号；否则输出‘0’电平。
/dl/175649.html
标签： 数控 分频器 加法 计数器
上传时间： 2015-07-16
上传用户：wxhwjf
Verilog HDL语言编写的5分频电路。采用两路时钟相逻辑作用产生。
/dl/176687.html
标签： Verilog HDL 语言 编写
上传时间： 2015-07-18
上传用户：yulg
vhdl语言写的基数分频器，多平台，通过MODESIM仿真
/dl/177213.html
标签： vhdl 语言 分频器
上传时间： 2015-07-20
上传用户：541657925
多数位分频器.............................................可直接编译
/dl/177798.html
标签： 数位 分频器 编译
上传时间： 2015-07-22
上传用户：whenfly
基于VHDL语言描述的一个分频器，根据端口值，可作为四分频，八分频等分频器使用。
/dl/177924.html
标签： VHDL 语言 分频器
上传时间： 2013-12-31
上传用户：集美慧
这是我自己编写的三分频，也就是奇数分频，占空比为1：1，当然如果需要其它奇数分频，只要将程序里面的N和counter修改即可
/dl/180615.html
标签： 编写 三分频
上传时间： 2015-08-06
上传用户：我们的船长
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