赛灵思采用专为 FPGA 定制的芯片制造工艺和创新型统一架构，让 7 系列 FPGA 的功耗较前一代器件降低一半以上。
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标签： FPGA 赛灵思 功耗 减
上传时间： 2013-11-18
上传用户：liaofamous
本白皮书介绍了有关赛灵思 28 nm 7 系列 FPGA 功耗的几个方面，其中包括台积电 28nm高介电层金属闸 (HKMG) 高性能低功耗（28nm HPL 或 28 HPL）工艺的选择。
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标签： FPGA 28 nm 赛灵思
上传时间： 2013-10-27
上传用户：giraffe
赛灵思推出的三款全新产品系列不仅发挥了台积电28nm 高介电层金属闸 (HKMG) 高性能低功耗 (HPL) 工艺技术前所未有的功耗、性能和容量优势，而且还充分利用 FPGA 业界首款统一芯片架构无与伦比的可扩展性，为新一代系统提供了综合而全面的平台基础。目前，随着赛灵思 7 系列 (Virtex®-7、Kintex™-7 ...
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标签： Virtex Kintex Artix FPGA
上传时间： 2013-11-15
上传用户：chenhr
随着HDL Hardware Description Language 硬件描述语言语言综合工具及其它相关工具的推广使广大设计工程师从以往烦琐的画原理图连线等工作解脱开来能够将工作重心转移到功能实现上极大地提高了工作效率任何事务都是一分为二的有利就有弊我们发现现在越来越多的工程师不关心自己的电路实现形式以为我只要将功能描述正确其 ...
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标签： Xilinx FPGA 华为 高级技巧
上传时间： 2013-11-06
上传用户：asdfasdfd
目前，大型设计一般推荐使用同步时序电路。同步时序电路基于时钟触发沿设计，对时钟的周期、占空比、延时和抖动提出了更高的要求。为了满足同步时序设计的要求，一般在FPGA设计中采用全局时钟资源驱动设计的主时钟，以达到最低的时钟抖动和延迟。 FPGA全局时钟资源一般使用全铜层工艺实现，并设计了专用时钟缓冲与驱动结构 ...
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标签： Xilinx FPGA 全局时钟资源
上传时间： 2014-01-01
上传用户：maqianfeng
介绍了基于Xilinx Spartan- 3E FPGA XC3S250E 来完成分辨率为738×575 的PAL 制数字视频信号到800×600 的VGA 格式转换的实现方法。关键词: 图像放大; PAL; VGA; FPGA 目前, 绝大多数监控系统中采用的高解析度摄像机均由47 万像素的CCD 图像传感器采集图像, 经DSP 处理后输出的PAL 制数字视频信号不能直接在VGA 显示器上显 ...
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标签： PAL-VGA FPGA 转换器
上传时间： 2013-12-03
上传用户：aa54
摘要：本文简要介绍了Xilinx最新的EDK9.1i和ISE9.1i等工具的设计使用流程，最终在采用65nm工艺级别的Xilinx Virtex-5 开发板ML505 上同时设计实现了支持TCP/IP 协议的10M/100M/1000M 的三态以太网和千兆光以太网的SOPC 系统,并对涉及的关键技术进行了说明。关键词：FPGA；EDK；SOPC；嵌入式开发；EMAC；MicroBlaze 本研究采 ...
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标签： FPGA 千兆以太网
上传时间： 2013-10-14
上传用户：sun_pro12580
利用系介质陶瓷材料研制的微波元器件，广泛应用于航空航天、军事及民用通信及电子设备中，在理论分析和工艺试验的基础上，通过对介质陶瓷材料组分和控制温度工艺研究，优化BaO-Nd2O3-TiO2组分材料，改进煅烧温度等工艺方法，研制出性能稳定性介质陶瓷材料。为研制用于高频、超高频电子设备中性能稳定微波元器件找到了有效的 ...
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标签： Ba-Nd-Ti 微波介质 Q值 陶瓷
上传时间： 2013-11-05
上传用户：kangqiaoyibie
通过分析流水线结构和单周期结构的片上网络路由器，提出了一种低延时片上网络路由器的设计，并在SMIC 0.13um Mixed-signal/RF 1.2V/3.3V工艺进行流片验证。芯片测试结果表明，该路由器可以在300 MHz时钟频率下工作，并且在相同负载下，与其他结构的路由器相比较，其能够在较低延时下完成数据包传送功能。 ...
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标签： 低延时 片上网络 路由器
上传时间： 2014-12-28
上传用户：bakdesec
工艺以太网用于控制级和单元级,实现计算机系统与自动化系统间的通讯 用于大规模数据的交换 能用于远距离传输 提供了工业环境和办公环境的联网
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标签： 工业
上传用户：netwolf
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