IGBT关断电压尖峰是其中的主要问题，解决它的最有效方法是采用叠层母线连接器件。针对二极管籍位型三电平拓扑两个基本强追换流回路，本文用ANSOFT Q3D软件比较研究了三类适用于多层母线排的叠层方案，并提出了一种新颖的叠层母线分组连接结构，结合特殊设计的吸收电容布局，减小了各IGBT模块的关断过冲，省去阻容吸收电路， ...
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标签： igbt 二极管
上传时间： 2022-06-22
上传用户：tqsun2008
本文对基于FPGA的对象存储控制器原型的硬件设计进行了研究。主要内容如下： ⑴研究了对象存储控制器的硬件设计，使其高效完成对象级接口的智能化管理和复杂存储协议的解析，对对象存储系统整体性能提升有重要意义。基于SoPC(片上可编程系统)技术，在FPGA(现场可编程门阵列)上实现的对象存储控制器，具有功能配置灵活，调试 ...
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标签： FPGA 对象存储 原型
上传时间： 2013-04-24
上传用户：lijinchuan
随着存储技术的迅速发展，存储业务需求的不断增长，独立的磁盘冗余阵列可利用多个磁盘并行存取提高存储系统的性能。磁盘阵列技术采用硬件和软件两种方式实现，软件RAID（Redundant Array of Independent Disks）主要利用操作系统提供的软件实现磁盘冗余阵列功能，对系统资源利用率高，节省成本。硬件RAID将大部分RAID功能集 ...
/dl/9705.html
标签： FPGA 磁盘阵列 控制器
上传用户：jeffery
1.利用贴片陶瓷电容器介质层的薄层化和多层叠层技术，使电容值大为扩大 2.单片结构保证有极佳的机械性强度及可靠性 3.极高的精确度，在进行自动装配时有高度的准确性 4.因仅有陶瓷和金属构成，故即便在高温，低温环境下亦无渐衰的现象出现，具有较强可靠性与稳定性 5.低集散电容的特性可完成接近理论值的电路设计 6.残留诱 ...
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标签： 贴片电容 规格 型号 选型
上传用户：hull021
第二部分：DRAM 内存模块的设计技术..............................................................143第一章 SDR 和DDR 内存的比较..........................................................................143第二章 内存模块的叠层设计......................................................................... ...
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标签： DRAM 内存模块 设计技术
上传时间： 2014-01-13
上传用户：euroford
设计了一种可在CMOS射频功率放大器中用于功率合成的宽带变压器。通过对变压器的并联和串联两种功率合成形式进行分析与比较，指出了匝数比、功率单元数目以及寄生电阻对变压器功率合成性能的影响；提出了一种片上变压器的设计方法，即采用多层金属叠层并联以及将功放单元内置于变压器线圈中的方式，解决了在CMOS工艺中设计 ...
/dl/24216.html
标签： CMOS 射频功率放大器 变压器 合成技术
上传时间： 2014-12-24
上传用户：ewtrwrtwe
40kHZ超声波发射电路之一，由F1~F3三门振荡器在F3的输出为40kHZ方波，工作频率主要由C1、R1和RP决定，用RP可调电阻来调节频率。 F3的输出激励换能器T40-16的一端和反向器F4，F4输出激励换能器T40-16的另一端，因此，加入F4使激励电压提高了一倍。电容C3、C2平衡F3和F4的输出，使波形稳定。电路中反向器F1~F4用CC4069六 ...
/dl/24754.html
标签： kHZ 40 超声波 收发
上传用户：chongchong1234
摘 要: 针对三峡水轮机叶片坑内移动式修焊机器人的作业过程测控问题, 研制了一种基于双数字信号处理器的嵌入式视觉反馈控制系统。 采用功能单元模块化设计思想和叠层积木式装配结构, 该系统将基于TM S320DM 642 的图像采集与处理、 基于TM S320L F2812 的运动控制与参数调整、 数字视频输入、 模拟视频输入、 模拟视频输出 ...
/dl/31993.html
标签： DSP 移动 焊 机器人
上传时间： 2013-10-08
上传用户：xinhaoshan2016
我采用XC4VSX35或XC4VLX25 FPGA来连接DDR2 SODIMM和元件。SODIMM内存条选用MT16HTS51264HY-667(4GB)，分立器件选用8片MT47H512M8。设计目标：当客户使用内存条时，8片分立器件不焊接；当使用直接贴片分立内存颗粒时，SODIMM内存条不安装。请问专家：1、在设计中，先用Xilinx MIG工具生成DDR2的Core后，管脚约束文件是否还可 ...
/dl/32710.html
标签： FPGA DDR2 连接 问题讨论
上传时间： 2013-10-12
上传用户：han_zh
/dl/40337.html
上传时间： 2013-10-21
上传用户：jjq719719
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