Altium_Designer规则设置技巧
/dl/39890.html
标签： Altium_Designer
上传时间： 2013-11-12
上传用户：VRMMO
针对重构文件的大小、动态容错时隙的长短、实现的复杂性、模块间通信方式、冗余资源的比例与布局等关键问题进行了分析。并对一些突出问题,提出了基于算法和资源多级分块的解决方法,阐述了新方法的性能,及其具有的高灵活性高、粒度等参数可选择、重构布线可靠性高、系统工作频率有保障的优点。 ...
/dl/40018.html
标签： FPGA 动态可重构 容错 技术研究
上传时间： 2013-11-23
上传用户：cylnpy
利用allegro进行仿真时的线路参数设置
/dl/40082.html
标签： Allegro 等长设置
上传时间： 2013-10-22
上传用户：chongcongying
赛灵思推出业界首款自动化精细粒度时钟门控解决方案，该解决方案可将 Virtex®-6 和 Spartan®-6 FPGA 设计方案的动态功耗降低高达 30%。赛灵思智能时钟门控优化可自动应用于整个设计，既无需在设计流程中添加更多新的工具或步骤，又不会改变现有逻辑或时钟，从而避免设计修改。此外，在大多数情况下 ...
/dl/40138.html
标签： 370 WP 智能时钟 动态
上传时间： 2015-01-02
上传用户：wutong
工作环境设置及软件安装这章介绍工作环境的设置及软件安装方面知识。为什么要进行工作环境设置呢？因为现在的PCB 工程师要设计的文件很多。文件多了如果不进行管理就会很混乱，导致以后的维护十分困难。所以要从刚开始学习的时候养成一个好的操作习惯，这是很有必要的。2.1 建立自己的工作目录在电脑的桌面上打开我的电脑， ...
/dl/40406.html
标签： protel 99 se 安装说明
上传时间： 2013-10-31
上传用户：jrsoft
定时程序控制器用于气缸、电磁阀等各种类型的设备控制，接线简单，用表格设置的方法代替编程方法，适合不熟悉编程的人员使用，初次使用者可参考本说明。
/dl/40684.html
标签： 定时 程控
上传用户：苍山观海
因为PCIE 3.0信号的速率可以达到8Gb/s，而且链路通道走线也可能会很长，这可能会导致高速信号衰减过大，在接收端无法得到张开的眼图。因此在PCIE 3.0的Tx和Rx端均使用了均衡设置，以补偿长链路时高速信号的衰减。
/dl/41611.html
标签： PCIE 3.0 力科 动态均衡
上传时间： 2013-10-27
上传用户：894448095
工程资源管理器 如何创建和使用 LabVIEW 中的 LLB 文件 如何使用 VI 的重入属性（Reentrant） 用户自定义控件中 Control, Type Def. 和 Strict Type Def. 的区别 调整控件和函数面板的首选项 在文件夹下直接创建新的 VI 图标编辑器上的鼠标双击技巧 第二章：简单程序结构 顺序结构 选择结构 事件结构 循环结构 定时结构 缓 ...
/dl/41664.html
标签： LabVIEW
上传时间： 2013-11-01
上传用户：ruixue198909
查询是信息管理系统中使用涉及用户最多使用最频繁的功能。为了提高用户查询的灵活性与查询效率，设计了基于多表的动态查询模块，使得用户可以自己选择查询数据项，动态组合查询条件。应用结果表明，该模块不仅提高了查询的灵活度与效率，而且增加了查询的信息量，用户的满意度达到了98% 以上。 ...
/dl/41808.html
标签： 动态查询 模块设计
上传时间： 2013-11-11
上传用户：18165383642
我们知道，只要在VI 属性的窗口外观设置中选择“显示菜单栏”，那么VI 在运行过程中，一般会在前面板窗口中显示菜单栏。
/dl/41981.html
标签： LabVIEW 运行 菜单
上传时间： 2013-10-16
上传用户：lgnf
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