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基于Quartus II FPGA/CPLD数字系统设计实例（VHDL源代码文件）

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软件大小：	32801 K
上传用户：	flyhack007
关键词：	Quartus FPGA CPLD VHDL
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				I/O Assignment Analysis Status : Successful - Sat May 12 22:53:25 2007
				Quartus II Version : 7.0 Build 33 02/05/2007 SJ Full Version
				Revision Name : add
				Top-level Entity Name : add
				Family : Cyclone II
				Device : EP2C8T144C8
				Timing Models : Final
				Total pins : 0 / 85 ( 0 % )
				Total virtual pins : 0
				Total PLLs : 0 / 2 ( 0 % )


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