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altera Quartus II modelSim 自動模擬搭配

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关键词：	modelSim Quartus altera II
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				-- FileName: Full_Adder.vhd
				entity Full_Adder is
					port(
							X,Y,CIN	:	in	BIT;
							COUT	:	out BIT;
							SUM		:	out	BIT
						);
				end entity Full_Adder;
				
				architecture syn of Full_Adder is
					signal temp1,temp2 : BIT;
				begin
					temp1 					temp2 					SUM 					COUT 					
				end architecture syn;


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