FPGA-CPLD_DesignTool(example5-6）

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__parfloorplannerappexewrap.rsp __parfloorplannerappexewrap.rsp ucfassignpackagepinsapp_tcl.rsp __mapfloorplannerappexewrap.rsp _editucf_exewrap.rsp __edntongd_exewrap.rsp _ngdtonc1_exewrap.rsp _ncdtotwr_exewrap.rsp

				-mode pipe -errlog __tx2bit_parFloorPlanner.err -tcl -command D:/Xilinx/data/projnav/__launchFloorPlanner.tcl __parFloorPlanner.rsp


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