设计与验证verilog hdl

源代码在线查看: latch.plg

软件大小: 1828 K
上传用户: NJ_WK
关键词: verilog hdl
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				@P:  Worst Slack : NA
				@P: latch Part : xc3s100evq100-4
				@P: latch I/O primitives : 2
				@P: latch I/O Register bits : 0
				@P: latch Register bits (Non I/O) : 0 (0%)
				@P: latch Total Luts : 0 (0%)
							

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