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设计与验证verilog hdl

源代码在线查看： mux2.v

软件大小：	1828 K
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关键词：	verilog hdl
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相关代码
mux2.v mux2.v mux2.v mux2.v mux2.v mux2.tlg mux2.srd mux2.v

				module mux (en, a, b, mux_out);
				
				input        en;
				input        a, b;
				output       mux_out;
				
				wire mux_out;
				 assign mux_out = (en)? a : b;
				
				endmodule


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