NC-Verlog/NC-VHDL/NC-SIM 1.150

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相关代码
half_adder_3.v half_adder_3.v half_adder_3.v half_adder_3.v half_adder_3.v half_adder_3.v half_adder_3.v half_adder_3.v

				module half_adder(a,b,out,carry);				input a,b;				output out,carry;				xor n1(out,a,b);				and n2(carry,a,b);				endmodule


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