PLL锁相环实现时钟提取,经过验证可以使用
资源简介:基于FPGA的新的DDS+PLL时钟发生器
上传时间: 2014-01-07
上传用户:ma1301115706
资源简介:fpga中pll时钟实现的源代码,可实现倍频或分频
上传时间: 2016-03-08
上传用户:hongmo
资源简介:PLL 时钟模块 Quartus II平台的简单设计实例 附仿真波形
上传时间: 2014-11-12
上传用户:小草123
资源简介:能读取/更改Nvidia显卡pll时钟信息,实现软超频的linux下源程序。
上传时间: 2014-06-28
上传用户:亚亚娟娟123
资源简介:使用输入时钟脉宽的调整,完成pll时钟输出的微调
上传时间: 2016-12-14
上传用户:wangxiaoacc
资源简介:PLL锁相环实现时钟提取,经过验证可以使用
上传时间: 2016-07-25
上传用户:sinotyk
资源简介:基于FPGA和PLL的函数信号发生器时钟部分的实现
上传时间: 2013-08-08
上传用户:xzt
资源简介:使用时钟PLL的源同步系统时序分析一)回顾源同步时序计算Setup Margin = Min Clock Etch Delay – Max Data Etch Delay – Max Delay Skew – Setup TimeHold Margin = Min Data Etch Delay – Max Clock Etch Delay + Min Delay Skew + Data Rate – Hold Ti...
上传时间: 2013-11-05
上传用户:VRMMO
资源简介:PLL是数字锁相环设计源程序, 其中, Fi是输入频率(接收数据), Fo(Q5)是本地输出频率. 目的是从输入数据中提取时钟信号(Q5), 其频率与数据速率一致, 时钟上升沿锁定在数据的上升和下降沿上;顶层文件是PLL.GDF
上传时间: 2014-06-09
上传用户:daguda
资源简介:LPC23xx系列ARM时钟源的选择、PLL的设置步骤以及注意事项等。PPT做的非常出色。
上传时间: 2016-11-18
上传用户:7676777