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Verilog 下 16位除法算法程序

  • 上传时间: 2013-11-26
  • 上传用户:susanxuwenjun
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  • 标      签: Verilog 除法 算法 程序

资 源 简 介

Verilog 下 16位除法算法程序,高精度,固定17个时钟周期

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