分频器的vhdl描述,在源代码中完成对时钟信号CLK的2分频,4分频,8分频,16分频
资源简介:分频器的vhdl描述,在源代码中完成对时钟信号CLK的2分频,4分频,8分频,16分频
上传时间: 2014-01-16
上传用户:奇奇奔奔
资源简介:常用2、4、6及任意偶数分频器的VHDL代码实现(原创)
上传时间: 2013-12-17
上传用户:330402686
资源简介:常用1、3、5及任意奇数分频器的VHDL代码实现(原创)
上传时间: 2013-12-26
上传用户:rishian
资源简介:任意整数分频器的vhdl源程序,放心使用. 无版权问题,欢迎copy.
上传时间: 2016-01-28
上传用户:372825274
资源简介:这是用VHDL语言写的32位分频器的程序,可直接运行,看结果,欢迎使用。多指正,交流。
上传时间: 2015-05-11
上传用户:chenlong
资源简介:任意N进制分频器的标准VHDL代码(原创)
上传时间: 2013-12-25
上传用户:洛木卓
资源简介:本文介绍了两种分频系数为整数或半整数的可控分频器的设计方法。其中之一可以实现50%的奇数分频。利用VHDL语言编程,并用QUARTERS||4.0进行仿真,用 FPGA 芯片实现。 关键词:半整数,可控分频器,VHDL, FPGA
上传时间: 2015-11-27
上传用户:tyler
资源简介:介绍了各种分频器的设计,VHDL描述。包括偶数分频器,奇数分频器,办整数分频器
上传时间: 2017-05-18
上传用户:haohaoxuexi
资源简介:数控分频器的输出信号频率为输入数据的函数。用传统的方法设计,其设计过程和电路都比较复杂,且设计成 果的可修改性和可移植性都较差。基于VHDL 的数控分频器设计,整个过程简单、快捷,极易修改,可移植性强。他可利用 并行预置数的加法计数器和减法计数器实现...
上传时间: 2014-11-29
上传用户:1051290259
资源简介:本文主要介绍了50%占空比三分频器的三种设计方法,并给出了图形设计、VHDL设计、编译结果和仿真结果。设计中采用EPM7064AETC44-7 CPLD,在QUARTUSⅡ4.2软件平台上进行。
上传时间: 2014-01-25
上传用户:凌云御清风