基于Verilog HDL 的一个CAN总线IP核。

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  标签： Verilog HDL CAN IP核

  上传时间： 2013-12-08

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  标签： Verilog-HDL 9.1 功能描述

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  标签： Verilog-HDL LCD 9.2 显示单元

  上传时间： 2014-06-23

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  标签： Verilog-HDL parameter 9.3 硬件电路

  上传时间： 2013-12-14

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  标签： Verilog-HDL 9.4 脉冲 频率

  上传时间： 2013-12-01

  上传用户：frank1234