Cadence® SoC Encounter RTL到GDSII系统为Cadence® Encounter数字集成电路设计平台的一个产品配置。支持超过5000万门180纳米以下工艺的层次化设计
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上传时间: 2016-12-28
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资源简介:verilog超详细的教程 数字集成电路设计入门--从HDL到版图,北大微电子学系,于敦山 ppt
上传时间: 2014-01-27
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上传时间: 2013-12-23
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上传时间: 2013-12-01
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上传时间: 2016-11-11
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