verilog编写随机数产生源程序,在硬件电路设计中应用广泛。本程序是在LFSR and a CASR 基础上实现的
资源简介:verilog编写随机数产生源程序,在硬件电路设计中应用广泛。本程序是在LFSR and a CASR 基础上实现的
上传时间: 2016-10-19
上传用户:王小奇
资源简介:这是我在matlab环境下编写的产生随机数的源程序,包括产生均匀分布和正态分布,参数接口十分灵活。
上传时间: 2014-01-06
上传用户:luke5347
资源简介:此文件为C语言编写的随机数产生算法
上传时间: 2015-02-09
上传用户:waitingfy
资源简介:八位的伪随机数产生的verilog文件linear-feedback-shift-register
上传时间: 2015-04-25
上传用户:fandeshun
资源简介:用Verilog HDL编写的0832源程序,实现对0832实现D/A转换。也可方便地转换为vhdl源程序。
上传时间: 2013-11-25
上传用户:qiao8960
资源简介:SystemC语言编写的随机数产生器,SystemC是C++语言的一个超集
上传时间: 2016-10-19
上传用户:时代电子小智
资源简介:用Verilog编写的一个简单的产生伪随机序列的代码(m序列),比较实用。
上传时间: 2017-06-27
上传用户:dave520l
资源简介:Verilog 编写的网卡DM9000A的IP核,altera公司寄的DE2系统中的源程序核
上传时间: 2016-09-17
上传用户:AbuGe
资源简介:Verilog 编写的ISP1362的控制器IP核,altera公司DE2系统中的源程序
上传时间: 2016-09-17
上传用户:稀世之宝039
资源简介:用verilog编写的高速8路并行dds模块,用于与高速da(1ghz或以上)接口产生任意频率正弦波,模块已经经过工程验证,用于产品中。
上传时间: 2014-01-04
上传用户:ruan2570406