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基于VHDL语言的3级序列的产生

  • 上传时间: 2014-01-15
  • 上传用户:rickie936
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  • 标      签: VHDL 语言 序列

资 源 简 介

基于VHDL语言的3级序列的产生,可以循环产生周期为7的m序列

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