应用软件根据BYPASS信号的值来决定是否使用PLL。如果使用PLL,那么它总是输出一个200MHz的时钟信号,并且联合系统分频器(SYSDIV)共同产生系统时钟。
馈送到PWM模块的时钟由系统时钟提供。如果应用中需要较低的PWM时钟,那么在时钟信号到达PWM模块前可以使用PWM分频器(PWMDIV)先分频。
ADC时钟使用一个时钟源(source)为200MHz的常量分频器,这就意味着如果要使ADC时钟的工作频率保持在14-18MHz范围内,必须使能并使用PLL。
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上传时间: 2014-05-07
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上传时间: 2016-03-30
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上传时间: 2013-10-17
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上传时间: 2013-12-02
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上传时间: 2015-02-12
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上传时间: 2013-12-26
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