一个自己编写的全数字锁相环及其测试向量,比较简单但功能基本达到。
资源简介:一个自己编写的全数字锁相环及其测试向量,比较简单但功能基本达到。
上传时间: 2013-12-22
上传用户:xinzhch
资源简介:采用用verilog语言编写的全数字锁相环的源代码,适合感兴趣的学习者学习,可以提高自己的能力,大家可以多交流哈
上传时间: 2022-05-22
上传用户:yiyewumian
资源简介:用verilog语言编写的全数字锁相环的源代码,基于fpga平台
上传时间: 2015-06-13
上传用户:wanqunsheng
资源简介:一种可编程的全数字锁相环的丝线,可以用来做一个小的课程设计
上传时间: 2014-02-11
上传用户:xwd2010
资源简介:基于FPGA的全数字锁相环设计,内有设计过程和设计思想
上传时间: 2013-08-13
上传用户:fqscfqj
资源简介:一种改进的全数字锁相环设计 一种改进的全数字锁相环设计
上传时间: 2013-12-24
上传用户:stampede
资源简介:比较好的技术文章《基于VHDL的全数字锁相环的设计》有关键部分的源代码。
上传时间: 2013-12-24
上传用户:362279997
资源简介:基于VHDL的全数字锁相环的设计 有关键部分的源代码 hehe !
上传时间: 2015-12-18
上传用户:hgy9473
资源简介:用于时钟恢复的全数字锁相环设计,可以去掉时钟的抖动。
上传时间: 2016-05-23
上传用户:stewart·
资源简介:基于FPGA的全数字锁相环设计,内有设计过程和设计思想
上传时间: 2017-02-11
上传用户:evil