用VHDL语言实现数显时钟

相 关 资 源

• 用VHDL语言实现数显时钟免费下载

  资源简介：用VHDL语言实现数显时钟，devid200.vhd为分频模块，scan.vhd为LED扫描模块，timecount.vhd为计数模块

  标签： VHDL 语言 数显 时钟

  上传时间： 2013-12-25

  上传用户：gtf1207

• 利用一块芯片完成除时钟源、按键、扬声器和显示器（数码管）之外的所有数字电路功能。所有数字逻辑功能都在CPLD器件上用VHDL语言实现。这样设计具有体积小、设计周期短（设计过程中即可实现时序仿真）、调试免费下载

  资源简介：利用一块芯片完成除时钟源、按键、扬声器和显示器（数码管）之外的所有数字电路功能。所有数字逻辑功能都在CPLD器件上用VHDL语言实现。这样设计具有体积小、设计周期短（设计过程中即可实现时序仿真）、调试方便、故障率低、修改升级容易等特点。 本设计采用...

  标签： CPLD VHDL 芯片 时钟源

  上传时间： 2014-01-02

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• 利用一块芯片完成除时钟源、按键、扬声器和显示器（数码管）之外的所有数字电路功能。所有数字逻辑功能都在CPLD器件上用VHDL语言实现。这样设计具有体积小、设计周期短（设计过程中即可实现时序仿真）、调试免费下载

  资源简介：利用一块芯片完成除时钟源、按键、扬声器和显示器（数码管）之外的所有数字电路功能。所有数字逻辑功能都在CPLD器件上用VHDL语言实现。这样设计具有体积小、设计周期短（设计过程中即可实现时序仿真）、调试方便、故障率低、修改升级容易等特点

  标签： CPLD VHDL 芯片 时钟源

  上传时间： 2013-12-26

  上传用户：qwe1234

• 用VHDL语言实现一个能显示时、分、秒的时钟：可分别进行时和分的手动校正；12小时、24小时计时制可选免费下载

  资源简介：用VHDL语言实现一个能显示时、分、秒的时钟：可分别进行时和分的手动校正；12小时、24小时计时制可选，12小时制时有上下午指示；当计时到预定时间（此时间可手动设置）时，扬声器发出闹铃信号，闹铃时间为10秒，可提前终止闹铃。

  标签： VHDL 分 语言 时钟

  上传时间： 2014-01-05

  上传用户：hn891122

• 该程序是用VHDL语言实现的时钟程序免费下载

  资源简介：该程序是用VHDL语言实现的时钟程序，用六个数码管分别显示时分秒，而且可以实现控制功能。

  标签： VHDL 程序 时钟程序 语言

  上传时间： 2013-12-23

  上传用户：2525775

• 该程序是用VHDL语言实现的时钟分频程序免费下载

  资源简介：该程序是用VHDL语言实现的时钟分频程序，可以把高频时钟信号分成低频时钟信号，便于实际应用。

  标签： VHDL 程序 时钟分频 语言

  上传时间： 2017-08-19

  上传用户：wcl168881111111

• 常用数字逻辑功能都在CPLD器件上用VHDL语言实现免费下载

  资源简介：利用一块芯片完成除时钟源、按键、扬声器和显示器（数码管）之外的所有数字电路功能。所有数字逻辑功能都在CPLD器件上用VHDL语言实现。这样设计具有体积小、设计周期短（设计过程中即可实现时序仿真）、调试方便、故障率低、修改升级容易等特点

  标签： CPLD VHDL 数字逻辑 器件

  上传时间： 2013-08-11

  上传用户：hn891122

• 用VHDL语言实现的基于FPGA的交换机设计免费下载

  资源简介：用VHDL语言实现的基于FPGA的交换机设计

  标签： VHDL FPGA 语言 交换机

  上传时间： 2013-04-24

  上传用户：归海惜雪

• FPGA串口界面调试程序,用VHDL语言实现免费下载

  资源简介：FPGA串口界面调试程序,用VHDL语言实现

  标签： FPGA VHDL 串口 调试

  上传时间： 2013-08-11

  上传用户：362279997

• 此程序用通过PFGA用VHDL语言实现了傅立叶变换免费下载

  资源简介：此程序用通过PFGA用VHDL语言实现了傅立叶变换，希望对大家有用

  标签： PFGA VHDL 程序 傅立叶变换

  上传时间： 2013-08-30

  上传用户：tonyshao