本VHDL源代码由顶层模块、测频模块、驱动模块、计算模块、LCD显示模块、复位模块组成

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  标签： 模块 VHDL LCD 源代码

  上传时间： 2015-10-18

  上传用户：时代电子小智

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  上传时间： 2015-05-08

  上传用户：3到15

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  标签： ASP 科研 实验 源代码

  上传时间： 2013-12-22

  上传用户：梧桐

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  上传时间： 2017-04-28

  上传用户：gxmm

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  资源简介：本设计要实现一个具有预置数的数字钟的设计,具体要求如下: 1. 正确显示年、月、日 2. 正确显示时、分、秒 3. 具有校时,整点报时和秒表功能 4. 进行系统模拟仿真和下载编程实验,验证系统的正确性

  标签： 正 预置数 数字 分

  上传时间： 2013-12-18

  上传用户：caixiaoxu26

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  标签： vhdl fpga 代码 等精度测频

  上传时间： 2014-01-21

  上传用户：zhangzhenyu

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  标签： DESCRIPTION 1997 0.2 645

  上传时间： 2016-04-01

  上传用户：脚趾头

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  标签： FPGA 多普勒 测频 系统设计

  上传时间： 2013-04-24

  上传用户：121212121212

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  标签： FPGA 信号 测频

  上传时间： 2013-06-02

  上传用户：youke111

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  标签： vhdl 数模 计费器 模块

  上传时间： 2015-10-08

  上传用户：q123321