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VHDL实现数字时钟

  • 上传时间: 2015-10-15
  • 上传用户:rylzll
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  • 标      签: VHDL 数字时钟

资 源 简 介

VHDL实现数字时钟,利用数码管和CPLD 设计的计数器实现一个数字时钟,可以显示小时,分钟,秒。程序主要要靠考虑十进制和六十进制计数器的编写。 以上实验的程序都在源代码中有详细的注释

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