用VHDL语言编写的三位二进制的乘法器,其原理是每位相乘后再错位相加
资源简介:用VHDL语言编写的三位二进制的乘法器,其原理是每位相乘后再错位相加
上传时间: 2014-08-31
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资源简介:用vhdl语言编写设计8位總線收發器,很不错,大家快下啊
上传时间: 2017-01-15
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资源简介:东南大学学生数字系统设计实验:用VHDL语言编写Printer与CPU互连的接口程序
上传时间: 2013-12-22
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资源简介:用VHDL语言编写的两个四位二进制数相减,其结果会出现进位
上传时间: 2015-08-25
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资源简介:用VHDL语言编写的三人表决器,多数服从少数,或者一致通过。
上传时间: 2014-01-11
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资源简介:基于fpga和sopc的用VHDL语言编写的EDA8位16进制频率计
上传时间: 2016-02-04
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资源简介:基于fpga和sopc的用VHDL语言编写的EDA的32位Nios CPU嵌入式系统软硬件设计
上传时间: 2016-02-04
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上传时间: 2013-12-09
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上传时间: 2014-01-03
上传用户:qunquan
资源简介:用VHDL语言编写的代码,以供大家学习和交流,方便大家学习!
上传时间: 2013-09-05
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