基于FPGA的can 总线设计,采用verilog语言编写。在FPGA的开发环境下,新建一个工程,然后将本文件中的各个源代码添加进工程里,即可运行仿真。
资源简介:基于FPGA的can 总线设计,采用verilog语言编写。在FPGA的开发环境下,新建一个工程,然后将本文件中的各个源代码添加进工程里,即可运行仿真。
上传时间: 2013-09-03
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资源简介:基于FPGA的can 总线设计,采用verilog语言编写。在FPGA的开发环境下,新建一个工程,然后将本文件中的各个源代码添加进工程里,即可运行仿真。
上传时间: 2015-07-06
上传用户:shus521
资源简介:基于FPGA的CAN总线控制器,VERILOGHDL源代码,Q2仿真实现。可用。
上传时间: 2013-12-15
上传用户:kernaling
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上传时间: 2013-09-01
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上传时间: 2013-07-24
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上传时间: 2015-09-16
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上传时间: 2015-10-05
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上传时间: 2016-03-27
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