用verlog语言编的一些基础实验,适合于FPGA/CPLD的初学者。内容包括8位优先编码器

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软件大小: 982 K
上传用户: downloader_006
关键词: verlog FPGA CPLD 8位
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				a[1] => LessThan~1.IN2
				a[1] => add~1.IN2
				a[1] => temp_reg~5.DATAA
				a[2] => LessThan~0.IN3
				a[2] => add~0.IN3
				a[2] => temp_reg~3.DATAA
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				b[0] => LessThan~0.IN6
				b[0] => temp_reg~2.IN0
				b[0] => LessThan~1.IN5
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				b[1] => reduce_nor~0.IN1
				b[1] => LessThan~0.IN5
				b[1] => temp_reg~1.IN0
				b[1] => LessThan~1.IN4
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				b[2] => reduce_nor~0.IN0
				b[2] => LessThan~0.IN4
				b[2] => temp_reg~0.IN0
				b[2] => LessThan~1.IN3
				b[2] => LessThan~2.IN2
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